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高速 ADC 的电源设计 免费猫

发布时间:2020-02-17 12:51:33 阅读: 来源:节流阀厂家

高速 ADC 的电源设计

就一个要求 3.3-V 电压轨的数据转换器而言,300mV 的 LDO 压降增加约 10% 的 ADC 功耗。这种效应在数据转换器中得到放大,因为它具有更小的工艺节点和更低的电源电压。例如,1.8V 时,相同 300-mV 压降增加约 17%(300 mV/1.8 V)的 ADC 功耗。因此,将该链的低噪声 LDO 去除可以产生巨大的节能效果。去除 LDO 还可以降低设计的板级空间、热量以及成本。

本文阐述了包括超高性能 16 位 ADC 在内的一些 TI 高速 ADC 可在 ADC 性能无明显降低的条件下直接通过开关稳压器驱动。为了阐述的方便,我们对两款不同的数据转换器(一款使用高性能BiCOM 技术(TI 的ADS5483),另一款使用低功耗CMOS 技术(TI 的ADS6148)进行了开关电源噪声敏感性研究。本文的其他部分对所得结果进行了一一介绍。

BiCOM 技术—ADS5483

这种工艺技术实现了宽输入频率范围下的高信噪比 (SNR) 和高无杂散动态范围 (SFDR)。BiCOM 转换器一般还具有许多片上去耦电容和非常不错的电源抑制比 (PSRR)。我们对 ADS5483 评估板 (ADS5483EVM) 进行了电源研究,其具有一个使用 TI TPS5420 开关稳压器 (Sw_Reg) 的板上电源;一个低噪声 LDO(TI 的 TPS79501);以及一个外部实验室电源使用选项。我们使用图 2 所示不同结构实施了 5 次实验,旨在确定 ADS5483 通过一个开关稳压器直接运行时出现的性能降低情况。由于ADS5483 模拟 5-V 电源到目前为止表现出对电源噪声的最大敏感性,因此该研究忽略了 3.3-V 电源的噪声。ADS5483 产品说明书中列出的PSRR 支持这种情况:两个 3.3-V 电源的 PSRR 至少高出 5-V 模拟电源20 dB。

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